一个厉害的芯片芯片74LS190同步计数器可以做加法也可以做减法

74LS190是同步十进制加/减计数器（又称可逆计数器），

漂亮的主板

它依靠加/减控制端的控制来实 现加法计数和减法计数。

CPU

CO/BO：进位输出/借位输出端；

CP：时钟输入端：

CT：计数控制端（低电平有效）；

Do~D3：并行数据输入端；

W：异步并行置入控制端（低电平有效）；

Qo~Q3：输出端；

RC：行波时钟输出端（低电平有效）；

U/D :加/减计数方式控制端。

下表为74LS190的状态表，从该表中可以看出，74LS190工作状态有4种：置数、 加计数、减计数和保持。

状态表

（1） 置数

74LS190置数（或称预置）是异步的。当置入控制端（LD非）为低电平时，不管时钟CP 端状态如何，输出端（Q0Q3）即可预置成与数据输入端（D0D3）相一致的状态。

（2） 计数

74LS190釆用同步计数方式。当CT非=O、 U非/D=0时进行加计数；当CT非=0 U非/D=l时 进行减计数。只有在CP为高电平时，UT非/和U非/D才可以跳变。

74LS190有超前进位功能。当计数上溢或下溢时，进位/借位输出端（CO/BO）输出一个 宽度约等于CP脉冲周期的高电平脉冲，行波时钟输出端（RC非）输出一个宽度等于CP低电 平部分的低电平脉冲。

（3） 保持

当LE非=1、CT非=1时，74LS190工作在保持状态，在该状态下，即使CP端输入时钟脉冲, 输出端（Q0Q3）数据也不会发生变化。

腾讯公司取得乘累加器芯片技术专利，有效减小了芯片的面积与功耗

金融界2023年11月21日消息，据国家知识产权局公告，腾讯科技（深圳）有限公司取得一项名为“包括乘累加器的芯片、终端及浮点运算的控制方法“，授权公告号CN111767025B，申请日期为2020年8月。

专利摘要显示，本申请公开了一种包括乘累加器的芯片、终端及浮点运算的控制方法，涉及芯片领域。上述乘累加器包括：浮点数的输入端、第一选择端、浮点通用单元与输出单元；浮点通用单元与浮点数的输入端、第一选择端、以及输出单元分别相连。在不同的浮点运算模式下，上述浮点通用单元可以将高位宽的浮点数拆分为低位宽的子操作数来进行乘累加运算，以及按照对浮点运算模式的选择，控制乘累加器中的乘法器与加法器进行拆分与重组，使乘累加器中的运算电路成为与浮点运算模式对应的运算电路，使得运算电路能够支持不同位宽的浮点数的乘累加运算，无需在芯片上集成至少两套硬件结构，有效的减小了芯片的面积与功耗。

本文源自金融界

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